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FPGA/CPLD文章列表

基于MCU CPLD變壓器測(cè)試系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

1引言 BX型信號(hào)變壓器,BG型軌道變壓器和ZG型硅整流器作為鐵路信號(hào)電器設(shè)備的前端,其工作的穩(wěn)定性、準(zhǔn)確性直接關(guān)系到行車安全,變壓器的可靠檢測(cè)是嚴(yán)抓質(zhì)量的第一步,對(duì)于生產(chǎn)廠家而 ...
2010年06月06日 15:17   |  
CPLD   MCU   變壓器  

并行NOR Flash在SOPC開發(fā)中的應(yīng)用

引言 隨著FPGA技術(shù)的發(fā)展,出現(xiàn)了一種新概念的嵌入式系統(tǒng),即SOPC(System On Programmable Chip)。SOPC技術(shù)融合了SoC和FPGA的優(yōu)點(diǎn),將處理器、片上總線、片上存儲(chǔ)器、內(nèi)部外設(shè)、I/O接口以 ...
2010年06月04日 16:49   |  
NOR   SoPC  

多節(jié)點(diǎn)大容量FPGA系統(tǒng)的遠(yuǎn)程升級(jí)方法

引言 多節(jié)點(diǎn)系統(tǒng),在目前的很多電子系統(tǒng)應(yīng)用場(chǎng)合都可以看到。這種多節(jié)點(diǎn)系統(tǒng)由于具有結(jié)構(gòu)可擴(kuò)展性、功能配置的靈活性以及便于查找故障節(jié)點(diǎn)等良好的可維護(hù)性得到了越來越廣泛的應(yīng)用。通常,多 ...
2010年06月04日 14:20   |  
FPGA  

利用FPGA和CPLD數(shù)字邏輯實(shí)現(xiàn)ADC

數(shù)字系統(tǒng)的設(shè)計(jì)人員擅長(zhǎng)在其印制電路板上用FPGA和CPLD將各種處理器、存儲(chǔ)器和標(biāo)準(zhǔn)的功能元件粘合在一起來實(shí)現(xiàn)數(shù)字設(shè)計(jì)。除了這些數(shù)字功能之外,F(xiàn)PGA和CPLD還可以使用LVDS輸入、簡(jiǎn)單的電阻電容(R ...
2010年06月04日 10:23   |  
ADC   CPLD   FPGA  

基于FPGA的圖像采集模塊設(shè)計(jì)

1 引言 圖像采集是圖像處理的前提。圖像采集卡是常用的圖像輸入設(shè)備,通常占用PC機(jī)總線的一個(gè)插槽。它主要包括圖像存儲(chǔ)器單元、CCD或CMOS攝像頭接口、PC機(jī)總線接口等。傳統(tǒng)的圖像采集卡大多 ...
2010年05月24日 15:32   |  
圖像采集  

Actel數(shù)模結(jié)合FPGA的遠(yuǎn)程控制器設(shè)計(jì)

引言 近年來,隨著人們對(duì)生活品質(zhì)的追求,每個(gè)家庭都越來越需要一個(gè)集控中心把家庭中的各種家電連接起來,并實(shí)現(xiàn)遠(yuǎn)程訪問、控制以及自動(dòng)監(jiān)測(cè)報(bào)警功能。網(wǎng)絡(luò)技術(shù)的發(fā)展使這一想法成為了現(xiàn)實(shí), ...
2010年05月13日 14:17   |  
Actel   FPGA   遠(yuǎn)程控制  

FPGA的可重構(gòu)測(cè)控系統(tǒng)應(yīng)用設(shè)計(jì)

1 可重構(gòu)測(cè)控系統(tǒng)的提出 測(cè)控系統(tǒng)一般是指基于計(jì)算機(jī)實(shí)現(xiàn)數(shù)據(jù)采集和控制的系統(tǒng)。測(cè)控系統(tǒng)在工業(yè)現(xiàn)場(chǎng)控制、家庭數(shù)字化管理、通信和網(wǎng)絡(luò)等方面應(yīng)用廣泛,并不斷向低成本、高速、高性能、智能化 ...
2010年05月12日 18:30   |  
FPGA   可重構(gòu)  

spartan6套件試用心得報(bào)告--001

試用者 吳雷,2010.5.9 Spartan6的板子從老郭那拿來也有一段時(shí)間了,無奈最近忙于兩個(gè)比賽,亂七八糟的事很多,老師居然把報(bào)名的事情推給我,幾個(gè)老師,學(xué)弟學(xué)妹報(bào)名都找我,不明白的也問我 ...
2010年05月10日 10:28   |  
Spartan  

在嵌入式設(shè)計(jì)中降低CPLD的功耗

從事便攜式或手持產(chǎn)品設(shè)計(jì)的工程師都明白對(duì)于如今的設(shè)計(jì),最大限度地降低功耗是必不可少的要求。但是,只有經(jīng)驗(yàn)豐富的工程師理解盡可能地延長(zhǎng)系統(tǒng)的電池壽命的那些微妙但又重要的細(xì)節(jié)。本文中我 ...
2010年04月30日 09:48   |  
CPLD   功耗   嵌入式   設(shè)計(jì)  

基于FPGA的高速FIFO電路設(shè)計(jì)

前言 在大容量高速采集系統(tǒng)項(xiàng)目的開發(fā)過程中,F(xiàn)PGA作為可編程邏輯器件,設(shè)計(jì)靈活、可操作性強(qiáng),是高速數(shù)字電路設(shè)計(jì)的核心器件。由于FPGA內(nèi)嵌存儲(chǔ)器的容量有限,通常不能夠滿足實(shí)際設(shè)計(jì)電路的 ...
2010年04月26日 15:22   |  
FIFO   FPGA   電路設(shè)計(jì)  

FPGA的在應(yīng)用編程技術(shù)研究

引言 在FPG人中實(shí)現(xiàn)在應(yīng)用編程(In Application Pro—gramming,IAP)有兩種方法:一種是,在電路板上加外電路。例如用MCU或CPLD來接收配置數(shù)據(jù),在被動(dòng)串行(PS)模式下由外電路編程FPGA或是編 ...
2010年04月24日 21:23   |  
FPGA   技術(shù)   研究   應(yīng)用  

一種基于VC++程序的FPGA重配置方案設(shè)計(jì)

引言 隨著大規(guī)模集成電路的快速發(fā)展,系統(tǒng)設(shè)計(jì)已從傳統(tǒng)的追求大規(guī)模、高密度逐漸轉(zhuǎn)向提高資源利用率,使有限的資源可以實(shí)現(xiàn)更大規(guī)模的邏輯設(shè)計(jì)。利用現(xiàn)場(chǎng)可編程邏輯器件FPGA的多次可編程配置 ...
2010年04月22日 17:16   |  
FPGA   程序   方案   設(shè)計(jì)  

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