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FPGA/CPLD文章列表

數(shù)字簽名算法SHA-1的FPGA高速實(shí)現(xiàn)

引言 隨著網(wǎng)絡(luò)的迅速發(fā)展,對(duì)安全性的需要越發(fā)重要。然而,盡管網(wǎng)絡(luò)技術(shù)進(jìn)步很快,安全性問(wèn)題仍然相對(duì)落后,并且在很多情況下只能靠虛擬私人網(wǎng)VPN和防火墻。因虛擬私人網(wǎng)是構(gòu)建在Internet外 ...
2010年06月25日 17:03   |  
SHA-1   數(shù)字簽名  

DS/FH混合擴(kuò)頻接收機(jī)解擴(kuò)及同步技術(shù)FPGA實(shí)現(xiàn)

DS/FH混合擴(kuò)頻通信系統(tǒng)中,需要數(shù)字下變頻器、相關(guān)累加器及碼發(fā)生器等完成下變頻、相關(guān)解擴(kuò)等運(yùn)算。通常采用專用芯片來(lái)完成這些功能,導(dǎo)致系統(tǒng)體積增大?不便于小型化。現(xiàn)代的EDA(電子設(shè)計(jì)自動(dòng)化 ...
2010年06月25日 16:31   |  
FPGA   擴(kuò)頻接收機(jī)   同步技術(shù)  

CPLD在高速數(shù)據(jù)采集系統(tǒng)中的應(yīng)用

CPLD是復(fù)雜的PLD,專指那些集成規(guī)模大于1000門(mén)以上的可編程邏輯器件。它由與陣列、或陣列、輸入緩沖電路、輸出宏單元組成,具有門(mén)電路集成度高、可配置為多種輸入輸出形式、多時(shí)鐘驅(qū)動(dòng)、內(nèi)含ROM ...
2010年06月25日 16:23   |  
CPLD   數(shù)據(jù)采集  

CPLD為控制核心16位高精度數(shù)字電壓表設(shè)計(jì)

1 引言 CPLD ( Complex Programmable Logic Device ) 是新型的可編程邏輯器件,與傳統(tǒng)ASIC相比,具有設(shè)計(jì)開(kāi)發(fā)周期短、設(shè)計(jì)制造成本低、開(kāi)發(fā)工具先進(jìn)等優(yōu)點(diǎn),特別適合于產(chǎn)品的樣品開(kāi)發(fā)和小批 ...
2010年06月25日 16:21   |  
16位   CPLD   高精度   數(shù)字電壓表  

利用EPLD實(shí)現(xiàn)TMS320C5402與SDRAM接口

在多媒體應(yīng)用中,多媒體信息絕大部分是視頻數(shù)據(jù)和音頻數(shù)據(jù),而數(shù)字化的視頻數(shù)據(jù)和音頻數(shù)據(jù)的數(shù)據(jù)量是非常龐大的。為了能夠及時(shí)完整地處理前端采集的數(shù)據(jù),一般系統(tǒng)都采用高速DSP和大容量緩沖存 ...
2010年06月24日 10:18   |  
EPLD   SDRAM   TMS320C5402   接口  

基于VHDL的交通燈控制器設(shè)計(jì)

應(yīng)用VHDL語(yǔ)言設(shè)計(jì)數(shù)字系統(tǒng),大部分設(shè)計(jì)工作可在計(jì)算機(jī)上完成,從而縮短系統(tǒng)開(kāi)發(fā)時(shí)間,提高工作效率。下面介紹基于VHDL設(shè)計(jì)交通燈控制器的一種方案,并給出源程序和仿真結(jié)果。 1 系統(tǒng)功能與 ...
2010年06月24日 10:01   |  
VHDL   交通燈   控制器  

基于FPGA的全數(shù)字鎖相環(huán)路的設(shè)計(jì)

數(shù)字鎖相環(huán)路已在數(shù)字通信、無(wú)線電電子學(xué)及電力系統(tǒng)自動(dòng)化等領(lǐng)域中得到了極為廣泛的應(yīng)用。傳統(tǒng)的全數(shù)字鎖相環(huán)路(DPLL)是由中、小規(guī)模TTL集成電路構(gòu)成。這類(lèi)DPLL工作頻率低,可靠性較差。隨著集 ...
2010年06月23日 23:16   |  
FPGA   全數(shù)字   鎖相環(huán)路  

基于CPLD的開(kāi)放式四軸運(yùn)動(dòng)控制器的設(shè)計(jì)

作為運(yùn)動(dòng)控制的核心部件,運(yùn)動(dòng)控制器普遍采用16位或32位微控制器,其靈活的系統(tǒng)集成方式和高速的指令執(zhí)行速度提高了運(yùn)動(dòng)控制性能、改善了控制系統(tǒng)的精度、增強(qiáng)了系統(tǒng)構(gòu)造的靈活性。如DeltaTau公 ...
2010年06月23日 23:07   |  
CPLD   開(kāi)放式   控制器   四軸運(yùn)動(dòng)  

VHDL語(yǔ)言中信號(hào)設(shè)置的不同方式及注意事項(xiàng)

1概述 VHDL是一種快速的電路設(shè)計(jì)工具,功能涵蓋 了電路描述、電路合成、電路仿真等三大電路設(shè)計(jì)工作。目前廣泛使用的軟件有Altera公司出品的 MAX+PLUSII,Xinlinx公司的Foundation等。 ...
2010年06月23日 14:46   |  
VHDL   信號(hào)設(shè)置   注意事項(xiàng)  

SDH中E1接口分接復(fù)用器VHDL設(shè)計(jì)及FPGA實(shí)現(xiàn)

為擴(kuò)大數(shù)字通信系統(tǒng)的傳輸容量,信道上的信號(hào)都是在發(fā)送端分接,在接收端復(fù)接。在通信接口電路中能完成這一功能的電路就叫作分接復(fù)用器。 該分接復(fù)用器提供了標(biāo)準(zhǔn)的E1接口可供SDH系統(tǒng)方便使 ...
2010年06月23日 14:12   |  
E1接口   FPGA   SDH   VHDL   分接復(fù)用器  

FPGA在鎖相頻率合成中的應(yīng)用

鎖相環(huán)路由于具有高穩(wěn)定性、優(yōu)越的跟蹤性能及良好的抗干擾性,在頻率合成中得到了廣泛應(yīng)用。但簡(jiǎn)單的鎖相環(huán)路對(duì)輸出頻率、頻率分辨率等指標(biāo)往往不能滿足要求,所以要對(duì)簡(jiǎn)單鎖相環(huán)路加以改進(jìn)。小 ...
2010年06月23日 10:57   |  
FPGA   鎖相頻率  

FPGA在數(shù)字式頻分多路副載波解調(diào)器中的應(yīng)用

隨著大規(guī)模集成電路技術(shù)和微型計(jì)算機(jī)技術(shù)的飛速發(fā)展,計(jì)算機(jī)化已經(jīng)成為遙測(cè)技術(shù)發(fā)展的方向和特征。傳統(tǒng)的模擬式頻分多路遙測(cè)系統(tǒng)已越來(lái)越無(wú)法適應(yīng)現(xiàn)代遙測(cè)技術(shù)的發(fā)展。因?yàn)樗哂幸韵轮旅娜秉c(diǎn) ...
2010年06月23日 10:55   |  
FPGA   多路副載波   解調(diào)器   數(shù)字式頻分  

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