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FPGA/CPLD
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[提問]
模塊實例化 新手求助
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109010118
109010118
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電梯直達
樓主
發表于 2012-5-29 21:30:31
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貿澤電子有獎問答視頻,回答正確發放10元微信紅包
關鍵詞:
模塊實例化
module f(...,S_out);
...
output S_out;
...
reg S_out;
endmodule
module top(...);
reg S_out;//S_out不是輸入輸出口
f U1(..,.S_out(S_out));
always @()
begin
...
Sout<=1;
...
end
endmodule
編譯跳出錯誤:top模塊中的寄存器S_out不能連接到U1的輸出端口S_out??
該怎么改?
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asyou
asyou
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沙發
發表于 2012-5-30 15:06:29
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改為wire型!
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asyou
asyou
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板凳
發表于 2012-5-30 15:21:54
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reg S_out;//S_out不是輸入輸出口
改為:
wire S_out;
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firecnmfly
firecnmfly
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地板
發表于 2012-5-30 22:17:17
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模塊實例化時要注意信號由哪傳向哪。從你給出的那點代碼看,你在模塊top中產生了信號S_out,并將S_out通過模塊 f 的端口傳入到模塊f內部,也就是說top中的S_out是源,所以模塊f內部的S_out應該為wire型,而且端口類型應該為wire,代表一根導線。
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firecnmfly
firecnmfly
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地下室
發表于 2012-5-30 22:19:16
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只看該作者
模塊實例化時要注意信號由哪傳向哪。從你給出的那點代碼看,你在模塊top中產生了信號S_out,并將S_out通過模塊 f 的端口傳入到模塊f內部,也就是說top中的S_out是源,所以模塊f內部的S_out應該為【wire】型,代表一根導線,而且端口類型應該為【input】。
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