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周立功Verilog HDL黃金參考指南

發布時間：2011-6-15 15:16 發布者：zlz000

關鍵詞：周立功 , Verilog , HDL

序言.............................................................................................................................. 4
指南的使用................................................................................................................................ 4
索引........................................................................................................................................... 4
用于定義Verilog 語法的記號說明............................................................................................... 4
Verilog 的簡單介紹....................................................................................................... 5
背景........................................................................................................................................... 5
語言........................................................................................................................................... 5
編譯........................................................................................................................................... 6
模塊結構.................................................................................................................................... 6
語句........................................................................................................................................... 7
按字母順序參考的部分................................................................................................. 9
Always....................................................................................................................................... 9
Begin....................................................................................................................................... 10
Case........................................................................................................................................ 12
編碼標準.................................................................................................................................. 13
注釋......................................................................................................................................... 14
連續賦值.................................................................................................................................. 15
Defparam................................................................................................................................ 16
Delay....................................................................................................................................... 17
設計流程.................................................................................................................................. 18
Disable.................................................................................................................................... 18
錯誤......................................................................................................................................... 19

周立功Verilog HDL黃金參考指南 .pdf

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