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例說FPGA連載25:CMOS攝像頭子板設計

發布時間:2016-8-27 17:42    發布者:rousong1989
例說FPGA連載25CMOS攝像頭子板設計
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SF-MT9D111子板的實物照片如圖2.43所示。
2.43 SF-MT9D111子板實物照片
SF-MT9D111子板上板載美光的CMOS攝像頭MT9D111,它是美光的一款在單芯片系統上集成了一個先進的200萬像素圖像傳感器和功能強大的圖像處理技術芯片。單芯片系統中的自動特性可以調整各種參數,以便在各種光照條件下拍攝到優質圖像。MT9D111也可以簡化設計工程師的工作,因為所有的處理功能、內存以及與鏡頭的接口都集成在一個單傳感器處理芯片上。 MT9D111是一顆1/3英寸、200萬像素的CMOS圖像傳感器,它自帶有集成的先進相機系統。此相機系統包含一個復雜的圖像流處理器(IFP)、一個實時JPEG編碼器、一個集成的微控制器、閃光控制、自動聚焦、光學縮放以及機械快門。整個系統級芯片(SoC)可以在低照度條件下具備卓越的性能,同時功耗很低。MT9D111的內部功能框圖如圖2.44所示。
2.44 MT9D111芯片內部功能框圖
SF-MT9D111子板的主要接口定義如表2.6所示。
2.6 SF-MT9D111子板連接引腳定義
名稱
位置
功能描述
SCL
P1-7
IIC配置時鐘信號。
SDA
P1-8
IIC配置數據信號。
PCLK
P1-11
視頻輸出時鐘同步信號。
VSYNC
P1-13
視頻輸出場同步信號。
HSYNC
P1-14
視頻輸出行同步信號。
MCLK
P1-16
MT9D111的時鐘輸入。
VD0
P1-24
視頻輸出數據總線
VD1
P1-23
視頻輸出數據總線。
VD2
P1-22
視頻輸出數據總線。
VD3
P1-21
視頻輸出數據總線。
VD4
P1-20
視頻輸出數據總線。
VD5
P1-19
視頻輸出數據總線。
VD6
P1-18
視頻輸出數據總線。
VD7
P1-17
視頻輸出數據總線。

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