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高級(jí)verilog RTL 設(shè)計(jì)指導(dǎo) STARC RTL STYLE GUIDE

發(fā)布時(shí)間：2014-12-30 14:10 發(fā)布者：看門(mén)狗

關(guān)鍵詞： verilog , RTL

本資料是由半導(dǎo)體設(shè)計(jì)協(xié)會(huì)專(zhuān)門(mén)為IC設(shè)計(jì)工程師們所編寫(xiě)的rtl設(shè)計(jì)規(guī)范。本書(shū)中涉及到信號(hào)命名規(guī)則，同步異步信號(hào)處理，以及testbench編寫(xiě)方法，scan時(shí)相關(guān)信號(hào)處理，以及dc綜合時(shí)的相關(guān)注意事項(xiàng)等等。

STARC RTL STYLE GUIDE.pdf (7.12 MB)

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