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FPGA研發(fā)之道(18)-設(shè)計不是湊波形(八)總線(上)

發(fā)布時間:2014-12-4 15:10    發(fā)布者:看門狗
關(guān)鍵詞: FPGA
作者:阿昏豆

如果設(shè)計中有多個模塊,每個模塊內(nèi)部有許多寄存器或者存儲塊需要配置或者提供讀出那么實現(xiàn)方式有多種,主要如下:

實現(xiàn)方式一:可以在模塊頂部將所有寄存器引出,提供統(tǒng)一的模塊進行配置和讀出。這種方式簡單是簡單,但是頂層連接工作量較大,并且如果配置個數(shù)較多,導(dǎo)致頂層中寄存器的數(shù)目也會較多。

實現(xiàn)方式二:通過總線進行連接,為每個模塊分配一個地址范圍。這樣寄存器等擴展就可以在模塊內(nèi)部進行擴展,而不用再頂層進行過多的頂層互聯(lián)。如下圖所示:



那如果進行總線的選擇,那么有一種極為簡單的總線推薦被使用,那就是AVALON-MM的總線

    ALTERA提出兩種總線類型,分別是AVALON-MM,  AVALON-ST。分別用于連接memeory 和數(shù)據(jù)流的傳送  MM不是你想的意思,其英文為memory map。實現(xiàn)內(nèi)存映射是其主要目的。主要信號包括如下表所示:

信號例子
address地址
read
readdata讀數(shù)據(jù)
write
writedata寫數(shù)據(jù)
waitrequest_n等待信號

AVALON-MM因此可以說是最簡單實用的總線形態(tài)了。對于其操作來說,總線為同步類型的總線,寫信號只需要在寫使能有效時,同時提供寫數(shù)據(jù)即可,而讀數(shù)據(jù)等待信號無效時,讀出數(shù)據(jù)有效。

   同樣數(shù)據(jù)類型讀數(shù)據(jù)(readdata)和寫數(shù)據(jù)(writedata)的寬度可以根據(jù)設(shè)計的需要靈活配置為(8,16,32----256---1024)BIT等值。即可以支持非常大的位寬,但普通應(yīng)用,只需要(8,16,32,64)BIT等即可滿足應(yīng)用。

那假設(shè)總線寬度32,基本上主流的數(shù)據(jù)總線的寬度。如果需要更細粒度的劃分,確定讀寫某個字節(jié)有效,那么byteenable信號也是必須的。其需要4bit來標(biāo)示32bit(4個byte)中那個有效,每一BIT表示一個字節(jié),因此如果要完全表示所有的字節(jié)有效,因此字節(jié)有效信號的寬度為(數(shù)據(jù)總線的寬度/8)。AVALON還可以有burst的操作。主設(shè)備可以通過burstcount設(shè)備確定brust的長度,為2的n-1次方。
    對于普通的應(yīng)用,通過上述表格中的基本操作即可滿足需求,這也正是AVALON-mm總線的優(yōu)勢。此外模塊按此標(biāo)準提供連接接口,各種模塊可以掛在NIOSII的片上系統(tǒng)上。

如果模塊之間為點對點的連接,同時傳遞大數(shù)據(jù)量的操作,那么的AVALON-mm總線就不太適合,因此AVALON_streaming總線就適合這種應(yīng)用場景。

AVALON_streaming總線本質(zhì)上是一種同步并行總線,即在同步時鐘狀態(tài)下,使能有效代表傳遞數(shù)據(jù)有效。其基本信號如下表所示:

信號例子
valid主設(shè)備數(shù)據(jù)有效
data數(shù)據(jù)信號
ready從設(shè)備準備好
start  of frame幀開始
end  of frame幀結(jié)束
empty幀結(jié)束信號時,空數(shù)據(jù)的位數(shù)



從上圖中,可以看出各信號在數(shù)據(jù)傳輸中的作用,對于從設(shè)備獲取數(shù)據(jù)的處理,就是VALID有效時,數(shù)據(jù)有效的采樣操作,非常簡單方便,易于處理。如果從設(shè)備設(shè)定ready永為1,則表示沒有反壓的機制,則主設(shè)備,可根據(jù)自身收包情況一直向從設(shè)備發(fā)送數(shù)據(jù)包。此外還有其他輔助信號,可以根據(jù)設(shè)計需要進行添加。

使用總線使模塊標(biāo)準化,便于代碼的移植和設(shè)計復(fù)用。同時標(biāo)準總線的設(shè)定和統(tǒng)一定義也利于項目團隊代碼的標(biāo)準化,便于理解和傳播。

下文將介紹兩種其他應(yīng)用較廣的總線形態(tài),AHB(AMBA) 和WISHBONE總線(待續(xù))。

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