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明德?lián)PFPGA設(shè)計(jì)技巧--gVim模板分享2

發(fā)布時(shí)間:2017-11-29 15:48    發(fā)布者:taiyangyu_2
關(guān)鍵詞: 明德?lián)P , FPGA , gVim , altera , xilinx
FPGA工程師都知道,Verilog代碼絕大部分都是always語句,結(jié)構(gòu)基本上都是一致的,為了減少重復(fù)性的工作,讓工程師專注于設(shè)計(jì)實(shí)現(xiàn),明德?lián)P精心制作了常用模板,只要你安裝好明德?lián)P提供的GVIM,就能使用這些模板了。
1.模塊的模板
在GVIM輸入“Module”并回車,如下圖所示

就能得到下面的模塊的模板。

模塊的模板包括了輸入輸出信號(hào)列表、信號(hào)定義,組合邏輯和時(shí)序邏輯等,這是一個(gè)模塊常用的組件。學(xué)員只需要理解各個(gè)部分的意義,按要求來填空就可以,完全沒有必要去記住。我看很多學(xué)員剛開始學(xué)習(xí)時(shí),花費(fèi)大量的時(shí)間去記住、背熟模塊,這是沒有意義的。
2.輸入“Reg1”并回車

就能得到單比特的reg信號(hào)定義

3.輸入“Reg2”并回車

就能得到2比特的reg信號(hào)定義

4.輸入“Reg8”并回車


就能得到8比特的reg信號(hào)定義

類似的快捷命令有:
reg信號(hào)
Reg1
Reg2
Reg3
Reg4
Reg8
Reg16
Reg32
wire信號(hào)
Wire1
Wire2
Wire3
Wire4
Wire8
Wire16
Wire32
input信號(hào)
Input1
Input2
Input3
Input4
Input8
Input16
Input32
output信號(hào)
Output1
Output2
Output3
Output4
Output8
Output16
Output32
要使用上面快捷命令,需要明德?lián)P的配置文件,歡迎關(guān)注明德?lián)P公眾號(hào)“fpga520”,或群544453837索取。口號(hào):多用模板,減少記憶,專注設(shè)計(jì)!

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taiyangyu_2 發(fā)表于 2017-11-29 16:39:54
本次分享的主題是《如何閱讀他人代碼》。無論是學(xué)習(xí),還是工作,閱讀他人代碼都是必不可少的。如果有注釋還好,沒有注釋或者不規(guī)范的代碼,絕對(duì)會(huì)讓人頭疼。本次公開課,將現(xiàn)場如何閱讀他人代碼,學(xué)好幾招,必定終身受用。 如果想?yún)⒓樱?qǐng)加公開課群:29,14,47,47,0
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